Q131.
TTL 與CMOS 邏輯電路一起使用時，通常需加
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難易度分析
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此題屬於基礎數位邏輯電路觀念題，考查不同邏輯家族（TTL 與 CMOS）之間的電位兼容性。評分基準在於是否能精準辨識兩者在邏輯高準位（High Level）上的門檻差異，並選擇正確的電路補償手段，而非僅憑常識判斷放大或轉換功能。
正確答案：④提升電阻 做為界面電路
④ 提升電阻 做為界面電路:提升電阻（Pull-up Resistor）是TTL驅動CMOS時最常用的界面電路。由於TTL的輸出高電平可能低於CMOS的輸入高電平門檻，透過提升電阻將輸出拉至VDD，可確保邏輯準位兼容，符合CNS數位電路介接規範。
錯誤選項解析
- ① 電壓放大:電壓放大並非TTL與CMOS介接的主要需求。TTL的輸出高電平約為2.4V~3.5V，而CMOS的輸入高電平門檻約為0.7×VDD（約3.5V），單純放大電壓無法解決邏輯準位匹配問題，且會增加電路複雜度。
- ② 電流放大:電流放大不是此情境的解決方案。TTL的扇出能力足以驅動CMOS輸入端，因為CMOS的輸入阻抗極高，所需驅動電流極小，故電流並非介接瓶頸。
- ③ A/D 轉換:A/D轉換用於類比信號轉數位信號的場合，與TTL和CMOS兩種數位邏輯電路之間的介接無關，此為混淆觀念。
Learning Tip
"此題核心考點為TTL與CMOS邏輯準位匹配問題。常考陷阱包括：混淆「TTL驅動CMOS」與「CMOS驅動TTL」兩種不同情境——前者需提升電阻解決高電平不足，後者通常可直接介接因CMOS輸出擺幅夠大。實務上還需注意電源電壓一致性與雜訊邊際（Noise Margin），確保系統穩定運作。"
學員答題分佈
①電壓放大0%
②電流放大0%
③A/D 轉換0%
④提升電阻 做為界面電路0%
此答題分佈是根據學員在 LongePass 模擬考等實際作答紀錄計算而成。與考友分享這道歷屆試題與詳細解析！